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2
回答
VHDL
测试
平台
为什么我要用VHDL创建一个
测试
工作台/
测试
床?坐下来操纵模拟器中的信号,以确保VHDL代码的行为正确,难道不是很好吗?
浏览 2
提问于2015-05-02
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4
回答
SIP
测试
平台
我正在寻找一个
测试
调用的工具。从SIP设备A向SIP设备B发起呼叫并报告结果的
平台
...thnx,cateof
浏览 3
修改于2010-03-04
得票数 18
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1
回答
黄瓜
测试
平台
一个消息来源说,Cucumber只能用于
测试
Web应用程序,另一个消息来源说Cucumber可以同时用于Web应用程序和Android,而另一个消息来源则不这样说。 哪一个是正确的?我们可以用Cucumber
测试
哪些
平台
?(例如( Web应用程序、Android等)
浏览 6
提问于2022-03-14
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3
回答
选择.NET - MbUnit的
测试
平台
还是微软的
测试
平台
?
我选择了这两位作为主要候选人。我的想法是:你认为我应该赌哪一个?
浏览 1
修改于2010-01-08
得票数 4
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1
回答
FSM的
测试
平台
我正在尝试为以下用vhdl创建的有限状态机实现一个
测试
平台
。问题是,目前,我在
测试
工作台中没有看到任何状态转换。模拟将停留在状态0。; end if; 以下是我到目前为止所做的
测试
我有一些内部信号,比如y(每个状态的输出)和count(我处于一个状态的时间),我可能应该在
测试
平台
中使用它们作为驱动程序。
浏览 18
修改于2020-02-23
得票数 0
1
回答
Verilog
测试
平台
比较
我有五个电路模拟和一些
测试
的结果,结果将被记录在故障表中。 现在,我必须将从新电路生成的值与从上面的电路模拟中获得的值进行比较。我这样做是为了知道我的新电路是从哪个故障类别开始的。
浏览 2
修改于2018-03-25
得票数 1
1
回答
Modelsim VHDL
测试
平台
after 5ns;L <= not F after 2ns;end Behavioral; 代码
测试
平台
如下
浏览 1
修改于2020-09-08
得票数 1
2
回答
测试
平台
移动设备
最糟糕的是,我以前见过
测试
平台
,但是再也找不到了。或者当我闭上眼睛的时候,请给我一个指向答案的链接。诚挚的问候
浏览 2
提问于2013-03-01
得票数 2
2
回答
套接字在线
测试
平台
有人知道一个网站可以接受TCP/IP套接字连接并显示发送给它的数据吗?有许多站点可以显示HTTP事务,还有许多可安装的程序可以这样做,但我还没有找到一个在线版本。
浏览 0
提问于2015-01-28
得票数 2
1
回答
用Modelsim编写
测试
平台
我试图用modelsim中的verilog语言编写一个
测试
平台
。我已经为
测试
平台
以及
测试
中的模块编写了代码。但是在编译它的时候,我收到一个错误,说编译失败了。那么,我们必须在单独的模块中编写
测试
平台
代码吗?对于被
测试
的模块,也必须编写相同的代码吗?
浏览 7
提问于2015-01-26
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3
回答
需要推荐使用
测试
平台
我们正在致力于计费系统(基于java的模块),我们希望有一个
测试
框架。该
测试
框架应该能够用于任何类型的计费场景(例如:公用事业账单支付、水电/或任何其他类型的计费),通常,计费实体具有客户名称/使用/等共同属性。我想选择一个合适的
测试
平台
来
测试
我们的计费模块。
浏览 6
修改于2015-01-20
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1
回答
VHDL
测试
平台
:输出不变
我目前正在学习如何为我的VHDL组件编写
测试
基准。我正在试着
测试
一个时钟同步器,只是由两个级联D型触发器组成.我已经写了一个
测试
台,提供了一个时钟和适当的输入信号刺激,但我看到输出没有变化,当我模拟,它只是停留在"00“。map(D=>A(n), CLK=>sys_clock, Q=>output(n), CLRN=>reset); 下面是
测试
台
浏览 1
修改于2017-06-06
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1
回答
VHDL
测试
平台
报告错误
在一个有自我检查
测试
平台
的项目上工作,有一个我不明白的问题。 以下代码的问题是仿真中的一个错误。
浏览 4
提问于2014-03-17
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2
回答
在elisp中
测试
平台
?
有没有一种方法可以
测试
当前的
平台
,然后执行或跳过OS特定的指令?
浏览 1
提问于2009-11-05
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2
回答
通用vhdl简易
测试
平台
downto 0)end Xand; beginend Behavioral; 我的
测试
台看起来是这样的因此,我想
测试
我的Xand程序的差异A和B值,从[0,256)。遗憾的是,我不知道如何使向量B等于0的方式与循环相比,这是行不通的。有人能解释一下我的泛型()做什么吗?
浏览 2
修改于2018-02-28
得票数 0
1
回答
创建AXI总线
测试
平台
我必须为我的项目创建包含AXI总线的
测试
平台
。 我开始编写写和读的接口和事务。
浏览 13
修改于2016-08-24
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1
回答
Verilog
测试
平台
中
测试
模式的循环
:6] x;endmodule 然后我想为它写一个
测试
台首先,我对x(没有数组)使用了7位寄存器--一切都正常,但是现在我想用几个
测试
模式运行它,所以我宣布了一个数组,并希望循环它,每次都用新的输入运行模块。
浏览 2
提问于2015-11-02
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1
回答
Verilog加法器
测试
平台
//In here, `WORD_LEN is 32. input [`WORD_LEN-1:0] in1, in2;endmodule /// `timescale 1ns/1ns reg in1, in2; Adder TestAdder(.in1(in1), .in2(in2),
浏览 10
提问于2019-10-04
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1
回答
VHDL使用for循环断言
测试
平台
我有一个VHDL问题:对于家庭作业,我们必须为我们设计的电路编写一个带有断言的
测试
平台
。我们应该
测试
每一个信号组合为位比较器。report "error"; report "error"; 首先,我
测试
了这个想法
浏览 0
修改于2019-12-25
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1
回答
SV
测试
平台
的配置类
我试图为一个SV
测试
平台
编写一个配置类,并希望直接从命令行决定事务类中rand字段的随机化。
浏览 0
提问于2018-01-16
得票数 0
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