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芯片开发语言：Verilog 在左，Chisel 在右
然后通过FIRRTL进行翻译。再往后走的话，其实是用Verilog那套流程去做，最后生成GDSII版图。 所以在这个过程当中，其实是明显的分成两个阶段了。 这个时候他其实就用了Chisel和FIRRTL里面的特性。 因为FIRRTL它有点像LLVM，它可以放很多的这样自己设计的模块，FIRRTL也可以定义自己需要的功能。
2.7K10编辑于 2023-05-08 - 来自专栏编译器开发
IC数字前端开源仿真工具和LLHD
其中，很重要的一部分内容就是硬件设计的中间表示IR的设计，目前CIRCT中包含了FIRRTL和LLHD两大类IR。
2.1K10编辑于 2021-12-09
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