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Cracking Digital VLSI Verification Interview
亚稳态是一种电路状态，在电路正常工作所需的时间内，电路无法稳定在的“ 0”或“ 1”逻辑电平的状态。通常在建立时间和保持时间违例时发生。
2.2K10发布于 2020-06-24 - 来自专栏摸鱼范式
Cracking Digital VLSI Verification Interview
sequence是编写property或断言的基本构建块。sequence可以认为是在单个时钟边沿求值的简单布尔表达式，也可以是在多个周期内求值的事件sequence。property可能涉及检查在不同时间开始的一个或多个sequence行为。因此，可以使用逻辑或sequence组合的多个sequence来构造property。
2.2K30发布于 2020-07-01 - 来自专栏摸鱼范式
Cracking Digital VLSI Verification Interview
UVM RAL（UVM Register Abstraction Layer）是UVM所支持的功能，有助于使用抽象寄存器模型来验证设计中的寄存器以及DUT的配置。UVM寄存器模型提供了一种跟踪DUT寄存器内容的方法，以及一个用于访问DUT中寄存器和存储器的层次结构。寄存器模型反映了寄存器spec的结构，能够作为硬件和软件工程师的共同参考。RAL还具备其他功能，包括寄存器的前门和后门初始化以及内置的功能覆盖率支持。
1.8K10发布于 2020-06-24 - 来自专栏摸鱼范式
Cracking Digital VLSI Verification Interview
多个sequence可以与同一个接口的driver并发交互。sequencer支持多种仲裁机制，以确保在任何时间点只有一个sequence可以访问driver。哪个sequence可以发送sequence_item取决于用户选择的仲裁机制。在UVM中实现了五种内置的仲裁机制。还有一个附加的回调函数可以实现用户定义的算法。sequencer具有一种称为set_arbitration()的方法，可以调用该方法来选择sequencer应使用哪种算法进行仲裁。可以选择的六种算法如下：
1.4K10发布于 2020-06-24 - 来自专栏摸鱼范式
Cracking Digital VLSI Verification Interview
virtual sequence是控制多个sequencer中激励生成的序列。由于sequence，sequencer和driver集中在单个接口上，因此几乎所有测试平台都需要virtual sequence来协调不同接口之间的激励和交互。virtual sequence在子系统或系统级别的测试台上也很有用，可以使单元级别的sequence以协调的方式运行。下图从概念上展示了这一点，其中virtual sequence具有三个sequencer的句柄，这些sequencer连接到driver，以连接到DUT的三个独立接口。然后，virtual sequence可以在每个接口上生成subsequence，并在相应的subsequencer上运行它们。
1.6K20发布于 2020-06-24 - 来自专栏摸鱼范式
Cracking Digital VLSI Verification Interview
覆盖点（coverpoint）是用于指定需要收集覆盖率的目标。Covergroup可以具有多个覆盖点以覆盖不同的表达式或变量。每个覆盖点还包括一组bin，这些bin是该覆盖点不同采样值。bin可以由用户定义，也可以缺省自动创建。在下面的示例中，有两个变量a和b，covergroup有两个coverpoint，他们会检查a和b的值。Coverpoint cp_a是用户定义的，bins values_a检测a是否覆盖到特定的值。Coverpoint cp_b是自动的，bin是自动生成的，会检测b是否覆盖到所有的可能性
2.1K50发布于 2020-07-01 - 来自专栏FPGA开源工作室
数字 VLSI 的设计注意事项
VLSI SoC 中的设计程序非常复杂。设计人员应该考虑所有可能的状态和输入，并以这样一种方式设计芯片，使其每次都能在每种状态和每种可能的输入下工作。 在本文中，我们将讨论设计数字 VLSI 电路时的亚稳态、建立时间和保持时间。 1 关键路径、吞吐量和延迟 关键路径是电路中最长的路径，限制了时钟速度。 4流水线 在 VLSI 设计中，由于广泛的组合电路，我们可能会面临很长的关键路径。在这种情况下，我们的时钟速度将降低，以确保与关键路径相关的延迟不会导致设置时间违规。
1.1K20发布于 2021-10-12 - 来自专栏光芯前沿
VLSI 2025 AMD短课：AI硬件平台的架构演进
AI硬件平台由前端数据中心网络、Scale-Out集群网络、Scale-Up Pod网络等部分构成，包含CPU、GPU等计算单元，以及DPU、RDMA NICs等连接设备，实现与存储、其他系统及互联网等的连接。
50010编辑于 2025-07-24 - 来自专栏芯智讯
英特尔被判侵犯VLSI公司专利
11月16日消息，据路透社报道，美国德克萨斯州联邦陪审团于当地时间周二公布了一项判决，认定英特尔侵犯了VLSI Technology公司专利，必须向VLSI Technology 赔偿 9.488亿美元 在为期 6 天审判中，VLSI 认为英特尔 Cascade Lake 和 Skylake 微处理器侵犯了VLSI公司有关改善数据处理的专利。 据悉，VLSI 是从荷兰芯片制造商恩智浦半导体手中收购的这项专利。VLSI 律师在法庭上指控英特尔芯片对其造成了“每秒数百万次的侵权行为”。 英特尔律师也在法庭中回击，强调这是公司工程师独立开发的结果，英特尔的现代微处理器无法与 VLSI 过时技术兼容。 不过，最终陪审团裁定 VLSI 可获得要求的全部赔偿金。 4月，VLSI 在另一起针对英特尔的专利判决中败诉。 目前 VLSI 还对英特尔提另两项专利诉讼，仍在北加州和德拉瓦州审理中，北加州案预计 2024 年开始进行判决。 编辑：芯智讯-林子
37520编辑于 2022-11-22 - 来自专栏光芯前沿
VLSI 2025 Alphawave短课：AIHPC背后的连接技术革命
该报告是2025年VLSI会议上Alphawave关于加速AI的连接技术的短课内容，作者为Tony Chan Carsone。
42010编辑于 2025-08-02 - 来自专栏芯智讯
英特尔与VLSI达成和解，双方同意结束价值40亿美元的专利诉讼
这一决定标志着英特尔将摆脱VLSI的纠缠，过去几年，英特尔已经在与 VLSI 的专利纠纷中损失了约30亿美元。 资料显示，VLSI 最初生产 ASIC，后来被飞利浦电子收购，后来在恩智浦旗下分拆出来。 早在2018年， VLSI指控英特尔侵犯了其拥有的五项专利，涉及安全通信、电源优化和交付以及倒装芯片互连等领域。在将近五年的诉讼之后，VLSI终于做出了妥协的决定。 当地时间周二，英特尔和 VLSI 发布了一份联合文件，其中英特尔和 VLSI双方同意撤回此案，并解决因英特尔使用上述专利而引起的所有争议。VLSI 还同意做出不再起诉的承诺。 而VLSI最终放弃这场诉讼似乎是因为该公司在从英特尔金库中已经成功榨取了大笔现金。迄今为止，VLSI在得克萨斯州提起的两起专利侵权诉讼中，已从英特尔处获得近 30 亿美元的赔偿。 一直以来，英特尔在对于反诉VLSI的尝试结果喜忧参半。英特尔至少两次对 VLSI 提起诉讼，其中一次是在 2019 年与苹果公司合作。但在这两个案件中，法院都认为指控不可信。
55240编辑于 2023-02-09 - 来自专栏芯智讯
英特尔赢得上诉，赔偿21.8亿美元的判决被撤销
此前VLSI在美国多个州起诉英特尔专利侵权，指控英特尔侵犯了最初由SigmaTel、飞思卡尔和恩智浦申请后被VLSI收购的19项专利，其中一些索赔已经被裁决驳回，另外一些仍未解决。 而根据彭博社的数据显示，这两项专利在2019年才被转移到VLSI Technology LLC上。 据相关媒体报道，今年6月，美国专利及商标局（United States Patent and Trademark Office，USPTO）宣布，VLSI的一项专利无效，这涉及到2021年英特尔与VLSI 而在今年5月，VLSI的另外一项专利也被宣告无效。 当然，VLSI也有权在在美国联邦巡回上诉法院（CAFC）对该决定提出上诉。
35510编辑于 2023-12-05 - 来自专栏AI科技评论
动态 | 清华大学Thinker团队在VLSI 2018发表两款极低功耗AI芯片
清华大学 Thinker 团队在VLSI会议上发表了两款极低功耗 AI 芯片（Thinker-II 和 Thinker-S）的相关论。 6 月 18 日至 22 日，2018 国际超大规模集成电路研讨会（2018 Symposia on VLSI Technology and Circuits，简称 VLSI）在美国檀香山召开。 VLSI 国际研讨会始于 1987 年，是全球先进半导体与集成电路领域的顶级会议，与 ISSCC 和 IEDM 并称微电子技术领域的「奥林匹克盛会」。 ? reconfigurable processor for deep neural networks with binary/ternary weights in 28nm CMOS, Symposia on VLSI Thinker-S 在 VLSI 2018 大会现场演示 四、总结 清华大学 Thinker 团队近年来设计了 Thinker 系列人工智能芯片，相关成果相继发表在 VLSI Symposia、ISCA
92140发布于 2018-07-27 - 来自专栏新智元
清华可重构神经网络计算芯片重大进展，突破计算和访存的瓶颈
【新智元导读】 在日本京都举办的 2017 VLSI 国际研讨会上，清华大学微纳电子系魏少军教授团队发表了题为 “A 1.06-to-5.09 TOPS/W Reconfigurable Hybrid-Neural-Network 6月6日，清华大学微纳电子系魏少军教授团队在日本京都举办的2017 VLSI Symposia on Technology and Circuits（简称VLSI国际研讨会）发表了题为 “A 1.06- Thinker芯片的技术指标 背景链接： VLSI国际研讨会始于1987年，是全球先进半导体与集成电路的学术盛会，是国际微电子领域的顶级会议，与ISSCC和IEDM并称微电子技术领域的“奥林匹克盛会”。 VLSI国际研讨会只接收极具应用前景的创新性研究成果，Intel、IBM等公司的许多核心技术大都选择在VLSI国际研讨会上首次披露。本次会议上，IBM就首次披露了5纳米集成电路制造工艺。
1.1K100发布于 2018-03-28 - 来自专栏云头条
英特尔未能推翻 21.8 亿美元的专利判决！
美国法官近日驳回了英特尔公司提出的这一请求：撤销此前陪审团要求该芯片制造商因专利侵权而向VLSI Technology LLC赔付21.8 亿美元的裁决。 陪审员在3月2日就英特尔侵犯之前归荷兰芯片制造商恩智浦半导体公司拥有的两项专利判决向VLSI分别赔付15 亿美元和6.75亿美元。 英特尔在寻求重新审判时表示，该判决受到错误的陪审团指示和证据裁定的影响，并且似乎基于英特尔的早期和解，VLSI自己的损害赔偿专家都承认这些和解没有可比性。 韦科地区的另一个陪审团于4月21日在VLSI要求赔偿31亿美元的另一起专利侵权诉讼中裁定英特尔胜诉。 相关阅读 · 英特尔侵犯芯片专利，被判赔偿 141 亿元
24620编辑于 2022-03-18 - 来自专栏摸鱼范式
“EDA算法”入门课程与书籍推荐
2、知名课程推荐 (1) EE 382V: VLSI Physical Design Automation (Spring 2015) 课程主页: http://users.ece.utexas.edu : http://people.eecs.berkeley.edu/~brayton/courses/219b/ (5)ECE6133: Physical Design Automation of VLSI http://limsk.ece.gatech.edu/ (6)超大规模集成电路CADI-理论 - 伊利诺伊大学香槟分校 课程主页 【公开课】超大规模集成电路CADI-理论 - 伊利诺伊大学香槟分校（VLSI Lim, Practical Problems in VLSI Physical Design Automation, Springer, 2008 C. J. Alpert, D. P. Machine Learning in VLSI Computer-Aided Design. Springer, 2019.
2.3K50发布于 2020-11-11 - 来自专栏芯智讯
可用于7埃米节点，imec首次展示功能性单片CFET器件
当地时间6月18日，imec（比利时微电子研究中心）通过官网宣布，在本周举行的 2024 年 IEEE VLSI 技术与电路研讨会 (2024 VLSI) 上， imec 首次展示了具有堆叠底部和顶部源 在 2024 年 VLSI 研讨会上，imec 首次展示了具有堆叠顶部和底部触点的功能性单片 CMOS CFET 器件。 在 2024 VLSI 中，我们表明将底部触点形成移至晶圆背面是可行的，尽管与晶圆键合和减薄相关的工艺步骤更多。
35910编辑于 2024-07-02 - 来自专栏TechBlog
计算机两种体系结构及指令集
指令复杂度对处理器的VLSI实现性能的影响：在计算机体系结构的VLSI实现时，为了达到更高的实现性能，要求VLSI实现的规整性，而CISC中，指令长短不一，控制逻辑的实现非常不规整，致使执行速度的进一步提高比较困难 RISC体系结构的这些特点简化了处理器的设计，在体系结构的VLSI实现时更加有利于性能的增强。 RISC组织结构比CISC结构有着显著的优点，主要表现在体系结构及VLSI实现上： 硬连线的指令译码逻辑; RISC指令集的简单性使得指令译码可以采取规则的译码逻辑，CISC处理器使用大的微码ROM进行指令译码
1.4K10编辑于 2022-12-07 - 来自专栏数据派THU
【2022新书】超大规模集成电路: 信号、语音和图像处理的VLSI体系结构
这个新卷介绍了各种VLSI(非常大规模集成)的DSP滤波器、语音滤波器和图像滤波器架构，详细介绍了它们的关键应用，并讨论了VLSI设计、模型和架构中使用的不同方面和技术，以及更多。 本书《信号、语音和图像处理的VLSI架构》为计算机算法领域提供了有用的研究，可用于各种算法电路，其数字实现方案和性能考虑。 由计算机算法架构领域的领先研究人员编写，这里提供的最先进的信息有助于为计算机科学、计算机工程和电气和电子工程的学生、教师和研究人员提供对VLSI的全面理解。 超大规模集成电路(VLSI)知识是理解工程硬件前景的基本需求之一。日复一日，它的成长探索了新的研究领域。 Evolution of 1-D, 2-D, and 3-D Lifting Discrete Wavelet Transform VLSI Architecture C. S. N.
65940编辑于 2022-09-09 - 来自专栏光芯前沿
VLSI 2025 imec短课：2.5D3D集成技术现状、核心突破与未来路线图
2025 Symposium on VLSI Technology and Circuits会议上，来自imec的Eric Beyne博士系统阐述了2.5D/3D集成技术的现状、核心突破与未来路线图，揭示了其在 随着CMOS 2.0概念的推进，通过器件层堆叠实现性能与密度的持续缩放，将成为突破传统物理极限的关键方向，推动VLSI技术在AI时代迈向新高度。 完整slides如下：
1.3K11编辑于 2025-08-06
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