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问Verilog宏展开
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Stack Overflow用户

提问于 2013-10-15 22:03:20

回答 1查看 1.8K关注 0票数 1

是否有任何工具(如ncverilog、VCS、synplify、vivado等)？它允许您看到Verilog或SystemVerilog宏的扩展输出？

我将编写一个脚本来解析宏并手动展开它们，以便调试由其他人编写的一些宏。如果已经有一些工具可以做到这一点，我很乐意使用这个工具。

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回答 1

Stack Overflow用户

回答已采纳

发布于 2013-10-15 23:05:38

VCS-DVE允许您在调试会话中展开宏，只需单击您希望看到的宏旁边的+：

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页面原文内容由Stack Overflow提供。腾讯云小微IT领域专用引擎提供翻译支持

原文链接：

https://stackoverflow.com/questions/19391894

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