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  • 来自专栏M不作声

    628试题

    第一次输出[9,2,3] [9,2,3],第二次输出[4,5,6] [9,2,3]

    1K20发布于 2020-07-06
  • 来自专栏嵌入式Linux系统开发

    思科2021试题

    更多嵌入式笔试面试题目看这篇文章 嵌入式笔试面试题目系列(汇总) ·················· END ··················

    1.4K50发布于 2021-05-28
  • 来自专栏嵌入式Linux系统开发

    远景能源2021试题

    1、长度最大为150的队列满二叉树,采用广度优先遍历时,能够容纳的二叉树最大的深度为?用公式算节点

    1.3K40发布于 2021-05-28
  • 来自专栏用户2442861的专栏

    网易2011试题详解

    http://blog.csdn.net/silangquan/article/details/18051675

    77310发布于 2018-09-18
  • 来自专栏嵌入式Linux系统开发

    大疆2021试题

    12 9 同一时间只能服务一个用户 1<=t<6 10元一小时 6<=t<10 5元一小时 10<=t 2元一小时 更多问题请参看以下文章: 嵌入式笔试面试题目系列

    3.3K20发布于 2021-05-28
  • 来自专栏M不作声

    72试面试题

    7.2上午笔试题 1、请描述cookie,sesstionStorage,localStorage三者之间的区别 有效时间:cookie在关闭浏览器后失效,sessionStorage在关闭页面后失效,

    1.1K20发布于 2020-07-06
  • 来自专栏嵌入式Linux系统开发

    康冠医疗2021试题

    6、const可以用来代替define ,define 只是简单的代替,但是const还会进行类型检查。

    71740发布于 2021-05-28
  • 来自专栏嵌入式Linux系统开发

    小马智行2021试题

    str1); scanf("%s", str2); printf("%d\n", CompareString(str1, str2)); return 0; } 更多嵌入式笔试面试题目看这篇文章 嵌入式笔试面试题目系列(汇总) ·················· END ··················

    2.1K40发布于 2021-05-28
  • 来自专栏嵌入式Linux系统开发

    乐鑫科技2021试题

    2、假设有n个核酸样本,其中m个病毒成阳性。一开始进行分组,就是武汉采用的分组检测。一组是阴性那么这一组就不再检测。一组是阳性,则再把这一组再次分组。

    1.7K40发布于 2021-05-28
  • 来自专栏嵌入式Linux系统开发

    科大讯飞2021试题

    ·················· END ··················

    2.3K70发布于 2021-05-28
  • 来自专栏嵌入式Linux系统开发

    杰发科技(合肥)2021试题

    杰发科技主要做汽车电子,由北京四维图新控股,对汽车电子感兴趣的有机会可以应聘试试。

    1.4K50发布于 2021-05-28
  • 来自专栏嵌入式Linux系统开发

    腾讯微民保险2021试题

    题型:单选题(3分×10),判断题(2分×5),问答题(10分×2),编程题(20分×2)。

    92640发布于 2021-05-28
  • 来自专栏嵌入式Linux系统开发

    景嘉微电子2021试题

    长沙景嘉微电子,在长沙找嵌入式工作,景嘉微的薪资是top级别的。并且公司有很多开发平台,都可以去应聘试试。

    1.3K30发布于 2021-05-28
  • FPGA相关职位试题分享(六)

    1.两离散序列X1=[0,1]、X2=[5,6,7],两者线性卷积结果后的序列是什么?

    3810编辑于 2026-03-23
  • FPGA相关职位试题分享(三)

    请设计基于verilog HDL的程序文件(.v),以及用于仿真的测试(testbench)文件(.v格式)。

    4110编辑于 2026-03-23
  • FPGA相关职位试题分享(五)

    NMOS英文全称为N-Metal-Oxide-Semiconductor。意思为N型金属-氧化物-半导体,而拥有这种结构的晶体管我们称之为NMOS晶体管。

    4810编辑于 2026-03-23
  • FPGA相关职位试题分享(四)

    1.对于一般的逻辑电平,各个电压参数(Voh、Vih、Vol、Vil、Vt)需要满足什么关系?

    6210编辑于 2026-03-23
  • FPGA相关职位试题分享(七)

    在时序逻辑电路中,无特殊说明时,前一级寄存器在第一个时钟边沿采样并发出数据,后一级寄存器在第二个时钟边沿采样前一级寄存器在第一个时钟边沿采样并发出的数据(该数据可能要经过一定的组合逻辑)。

    4310编辑于 2026-03-23
  • FPGA相关职位试题分享(一)

    1. A=2‘h2,S=1;assign B= S ?A[1] : A[0];那么B等于多少?

    3510编辑于 2026-03-23
  • FPGA相关职位试题分享(二)

    1. 用verilog设计一个模块,模块名称为clock_gen,模块输入为(input sys_clk, input sys_rst_n),模块输出为(output reg pulse_1ms, output reg pulse_1s)。

    6110编辑于 2026-03-23
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