blocks|key|2712131|text|单周期处理器中的每条指令都需要一个时钟周期，因此每个指令CPI的时钟周期为1。|type|unstyled|depth|inlineStyleRanges|offset|length|style|BOLD|entityRanges|data|2712132|周期时间Tc+(时钟周期)取决于关键路径、逻辑设计和组件的延迟。延迟大约是皮秒(ps+10%5E-12)。|CODE|2712133|+Tc+=+t_pcqPC+%2B+2t_mem+%2B+t_RFread+%2B+t_ALU+%2B+t_mux+%2B+t_RFsetup|code-block|syntax|javascript|2712134|这里的一个示例展示了如何为Tc计算lw。|2712135|​|2712136|📷|atomic|2712137|2712138|循环时间是|2712139|Tc+=+30+%2B+2(250)+%2B+150+%2B+200+%2B+25+%2B+20+=+925+ps|2712140|对于R型指令，时钟周期Tc比lw短，因为它们没有内存访问和t_mem+=+0。哈里斯和哈里斯。|2712141|entityMap|0|IMAGE|mutability|IMMUTABLE|imageUrl|https://developer.qcloudimg.com/http-save/yehe-900000/029499b3b17b250e959fb88ec6a9be83.png|imageAlt^0|S|3|0|4|2|14|9|0|0|D|2|H|2|0|0|0|1|0|0|0|0|0|B|2|E|2|T|9|0^^$0|@$1|2|3|4|5|6|7|1A|8|@$9|1B|A|1C|B|C]]|D|@]|E|$]]|$1|F|3|G|5|6|7|1D|8|@$9|1E|A|1F|B|H]|$9|1G|A|1H|B|H]]|D|@]|E|$]]|$1|I|3|J|5|K|7|1I|8|@]|D|@]|E|$L|M]]|$1|N|3|O|5|6|7|1J|8|@$9|1K|A|1L|B|H]|$9|1M|A|1N|B|H]]|D|@]|E|$]]|$1|P|3|Q|5|6|7|1O|8|@]|D|@]|E|$]]|$1|R|3|S|5|T|7|1P|8|@]|D|@$9|1Q|A|1R|1|1S]]|E|$]]|$1|U|3|Q|5|6|7|1T|8|@]|D|@]|E|$]]|$1|V|3|W|5|6|7|1U|8|@]|D|@]|E|$]]|$1|X|3|Y|5|K|7|1V|8|@]|D|@]|E|$L|M]]|$1|Z|3|10|5|6|7|1W|8|@$9|1X|A|1Y|B|H]|$9|1Z|A|20|B|H]|$9|21|A|22|B|H]]|D|@]|E|$]]|$1|11|3|-4|5|6|7|23|8|@]|D|@]|E|$]]]|12|$13|$5|14|15|16|E|$17|18|19|-4]]]]

Each instruction in the single-cycle processor takes one clock cycle, so the clock cycle per instruction CPI is 1.

The cycle time <code>Tc</code> (clock period) depends on the critical path, logic design and that the component have delays. The delays are around picoseconds(<code>ps 10^-12</code>).

<pre><code> Tc = t_pcqPC + 2t_mem + t_RFread + t_ALU + t_mux + t_RFsetup
</code></pre>

An example here that show how to calculate the <code>Tc</code> for <code>lw</code>.

<a href="https://i.stack.imgur.com/fbpXW.png" rel="nofollow noreferrer"><img src="https://i.stack.imgur.com/fbpXW.png" alt="delay"></a>

The cycle time is

<pre><code>Tc = 30 + 2(250) + 150 + 200 + 25 + 20 = 925 ps
</code></pre>

The clock period <code>Tc</code> is shorter for an R-type instruction than <code>lw</code> since they do not have memory access and <code>t_mem = 0</code>.
[Harris &amp; Harris].

I'm given timing information for 

<ol>
<li>IF (fetch instruction)</li>
<li>ID (decode instruction)</li>
<li>EX (Execute)</li>
<li>MEM (Memory)</li>
<li>WB (write back)</li>
</ol>

I derived that the clock cycle time of a single cycle processor is just all 5 aforementioned timings summed up, since there is no pipe lining (I hope that's the right justification). 

However, if I were to calculate the CC time of a specific instruction such as a slt instruction, then do I only add the times of the components that are relevant? For instance, slt doesn't have to access memory, so can I exclude that in my summation?

clock cycle time of a "slt" instruction on single cycle processor

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我得到了时间信息如果(取指令)ID (解码指令)执行(执行)MEM (记忆)WB (回电)我推导出，单周期处理器的时钟周期时间只是上述5个时间的总和，因为没有管道内衬(我希望这是正确的理由)。但是，如果我要计算特定指令(如slt指令)的CC时间，那么我是否只添加相关组件的时间？例如，slt不需要访问内存，所以我可以在求和中排除它吗？

问单周期处理器上slt指令的时钟周期时间
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