blocks|key|975751|text|我不建议您使用PLL或MMCM+IP模块，您可以在Vivado中使用configure。|type|unstyled|depth|inlineStyleRanges|entityRanges|offset|length|data|975752|entityMap|0|LINK|mutability|MUTABLE|url|https://en.wikipedia.org/wiki/Phase-locked_loop|1|https://www.xilinx.com/products/intellectual-property/mmcm_module.html|2|https://www.xilinx.com/support/documentation/sw_manuals/xilinx2019_2/ug896-vivado-ip.pdf^0|7|3|0|B|4|1|Y|9|2|0^^$0|@$1|2|3|4|5|6|7|P|8|@]|9|@$A|Q|B|R|1|S]|$A|T|B|U|1|V]|$A|W|B|X|1|Y]]|C|$]]|$1|D|3|-4|5|6|7|Z|8|@]|9|@]|C|$]]]|E|$F|$5|G|H|I|C|$J|K]]|L|$5|G|H|I|C|$J|M]]|N|$5|G|H|I|C|$J|O]]]]

<p>I recommend against it, you should use a <a href="https://en.wikipedia.org/wiki/Phase-locked_loop" rel="nofollow noreferrer">PLL</a> or <a href="https://www.xilinx.com/products/intellectual-property/mmcm_module.html" rel="nofollow noreferrer">MMCM</a> IP modules, which you can <a href="https://www.xilinx.com/support/documentation/sw_manuals/xilinx2019_2/ug896-vivado-ip.pdf" rel="nofollow noreferrer">configure</a> in Vivado.</p>


<p>I have a basys3 board with a 100MHZ oscillator, I was wondering if it would be feasible to get a 200Mhz clock by pulsing the output on the rising and falling edge of the 100Mhz oscillator. I cant seem to find any material online about people attempting this. thanks for any and all help.</p>


FPGA clock multiplication?

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我有一个100 the振荡器的basys3板，我想知道是否可以通过在100 the振荡器的上升和下降沿上脉冲输出来获得200 the时钟。我似乎在网上找不到任何关于人们尝试这样做的材料。感谢大家的帮助。

问FPGA时钟倍增？
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