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串行外设接口
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Stack Overflow用户
提问于 2013-02-15 13:43:27
回答 1查看 653关注 0票数 1

我正在浏览一篇与SPI相关的文章。有一个名为“菊花链”的配置,用于多个从机的情况。

到目前为止,我对SPI (基于维基百科)的理解是,

SPI可以同时传输和接收一些数据。

我的问题是,

1)在多个从设备的情况下,这是否意味着它向多个从设备传输数据,或者它在与多个从设备的连接中向其中一个从设备传输数据?

2)根据this link图4,假设主机将其SS保持为低电平,直到它需要发送到3个从设备的所有数据发送完毕,然后将引脚设为高电平。如果是,那么主设备最终会从哪个从设备接收什么数据?

3)如this link所示,在增强模式下,会检查加载使能(LDEN)和WCOL,以将下一个字节移入缓冲区。为什么我们需要同时检查它们呢?WCOL还不足以做到这一点吗?

4)给定的情况下,Master configures the clock - frequency less than or equal to the maximum frequency the slave device supports. Such frequencies are commonly in the range of 1–100 MHz.主机如何找到从机的时钟频率?

5) SPSR、SPCR和SPDR寄存器是否同时保留在主和从中?

6)假设在传输完成后设置SPIF标志。如果SPIE也被使能,则产生中断。在主设备和从设备中是否都设置了这些标志?主设备和从设备都会产生中断吗?

请指点一下。提前谢谢。

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回答 1

Stack Overflow用户

回答已采纳

发布于 2013-02-15 23:03:09

1)同时(在/CS上升沿)一个或多个从机的任意组合。

2)将从机的组合看作一个大的移位寄存器。假设三个从机中的每一个都有一个8位寄存器,总寄存器为24位。主机将输出24位,前8位将写入最后一个从站,第二个8位将写入第二个,最后8位将写入第一个从站。当/CS解除断言(上升沿)时,每个从机中的数据都会被接受,因此只有那些在数据时钟期间/CS处于低电平的从机才会受到影响。

票数 1
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页面原文内容由Stack Overflow提供。腾讯云小微IT领域专用引擎提供翻译支持
原文链接:

https://stackoverflow.com/questions/14888946

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